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DSP builder能生成Verilog吗

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 楼主| cwfboy 发表于 2010-9-2 17:41 | 显示全部楼层 |阅读模式
builder, DSP, verilog, verilo, ui
如题 可以生成 Verilog描述吗？求指点
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ar_dong 发表于 2010-9-3 09:21 | 显示全部楼层
DSP builder生成的是C代码吧
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 楼主| cwfboy 发表于 2010-9-3 09:38 | 显示全部楼层
DSP builder 生成的是C吗？？？？？ 默认的不是VHDL吗
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ar_dong 发表于 2010-9-3 14:06 | 显示全部楼层
那我错了
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