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FPGA 中的 Jitter

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jancey|  楼主 | 2010-9-7 10:55 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式
FPGA, jitter, PLL, 数据手册, 芯片
FPGA芯片的数据手册上写的PLL的OUT jitter为300ps,是不是对什么精度的晶振都是如此？是不是jitter大于PLL输出jitter的信号，经过PLL后，jitter都会变小？都会变得和PLL一样?

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沙发
小毛毛虫| | 2010-9-9 11:29 | 只看该作者
各位前辈，帮帮忙啊~~

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caecar| | 2010-9-10 12:51 | 只看该作者
是的

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jancey|  楼主 | 2010-9-21 14:50 | 只看该作者
没人看到？

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5楼
SuperX-man| | 2010-9-21 16:41 | 只看该作者
回楼主话,是的.
外部信号经过PLL后会可以有效减少jitter,但不一定都能达到300ps,不过效果会很明显.

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6楼
jancey|  楼主 | 2010-9-25 17:42 | 只看该作者
多谢超人同志！

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