[ZLG-MCU] 复习 铃木雅臣《晶体管电路设计》,疑惑不解,与大家讨论

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 楼主| xieshuangok 发表于 2010-10-16 11:50 | 显示全部楼层 |阅读模式

先上图,
问题是:图中说明输入  Vi = 8Vp-p正弦波时,负载为680时输出会发生输出波形负侧的波形被截去??

书本上解释是:当交流地看这个电路时,则因R3与RL是并联连接的,其两端电压降不在-3.3V(约等于9.7mA*340Ω)一下。(原书P52-53页)

现在想讨论的是:为什么加负载为680Ω时输出负侧会被截去?


补充我的计算:   静态工作状态下Vb、Ve、Ie已经在图中给出,在动态情况下计算为:  (Ve±Vi/2)=6.8±4V,完全符合晶体管承受范围,为什么会出现负侧被截去?

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明天我还来 发表于 2010-11-15 17:08 | 显示全部楼层
我还不太懂,帮顶吧
amini 发表于 2010-11-30 17:17 | 显示全部楼层
我帮你喊高手。
七叶一枝花 发表于 2010-12-3 21:21 | 显示全部楼层
米其林r 发表于 2010-12-12 17:55 | 显示全部楼层
这个到这版块问貌似没有人会!
fangfei036 发表于 2011-8-31 16:13 | 显示全部楼层
不知哪裡看到過,貌似跟Vc有關,幫頂...期待
fangfei036 发表于 2011-8-31 16:14 | 显示全部楼层
不知哪裡看到過,貌似跟Vc有關,幫頂...期待
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