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信号下降沿有什么意义

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楼主
kubuco|  楼主 | 2011-2-12 11:01 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式
信号
信号的上升沿与信号所包含的频率分量有关，高频分量越多，信号上升沿越陡。
那信号下降沿呢 有什么意义呢。

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沙发
maychang| | 2011-2-12 11:12 | 只看该作者
信号下降沿和上升沿是一样的。实际上，下降就是负向的上升。
有什么意义？显然上升下降沿越陡，对信号通路的带宽要求就越高。

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板凳
mmax| | 2011-2-12 11:12 | 只看该作者
用逻辑数学给你推到一下。

下降沿 = -上升沿
F(上升沿) = sigma[Ai*sin(F*i+Qi)]
F傅里叶展开，sigma求和符号。i=0,1,2,3...  A各个谐波赋值，F基波频率，Q相位

所以
F(下降沿)
=F(-上升沿)
= - sigma[Ai*sin(F*i+Qi)]
=  sigma[Ai*sin(F*i+Qi+180)]

所以，下降沿含有同上升沿一样多的谐波成分，只是相位差180度。

因此同样，高频分量越多，信号下降沿越陡

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地板
kubuco|  楼主 | 2011-2-12 11:26 | 只看该作者
那测试时要分Tr与Tf 又是什么讲究呢。这样说来测一个不就得了么？

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5楼
mmax| | 2011-2-12 11:46 | 只看该作者
这跟1楼是两个问题。

你具体的应用电路和测试项目是什么？

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6楼
kubuco|  楼主 | 2011-2-12 11:51 | 只看该作者
想测试下信号质量。。包括时序 电平。

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7楼
chunyang| | 2011-2-12 19:31 | 只看该作者
二者是一回事。

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8楼
diweo| | 2011-2-12 20:01 | 只看该作者
头晕

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9楼
iC921| | 2011-2-12 20:21 | 只看该作者
下降沿当然也不能慢
这并不单单是对称工作的要求，事实还和节能有关——快速跨越过渡区，是节电。如果不是这样，让它象海潮一样慢慢回落也无妨。

过渡区的电流很大。

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10楼
iC921| | 2011-2-12 20:33 | 只看该作者
本来想找张图，可是，想了半天记不起来在哪个文件有了……对不起

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11楼
kubuco|  楼主 | 2011-2-13 19:22 | 只看该作者
没事 慢慢找。。O(∩_∩)O  不知道有没专门研究这个课题的。

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12楼
mmax| | 2011-2-13 23:16 | 只看该作者
你这个帖子有三个问题。
1)下降沿是否也含有谐波（频率分量，高频）
     答案May叔，春阳老师都回答了：上升沿和下降沿是一样的。

2）为什么要测Tf？只测Tr为什么不行？
     可能大部分IC对Tr和Tf的要求一样，但是你实际电路波形，Tr和Tf肯定不一样，能不能都满足，就需要单独测一测。

3）为什么要测沿时间？沿时间是波形质量吗。
     a.沿比较慢的话，碰到一些非施密特的逻辑输入，在电平翻转点停留时间长，更容易受干扰翻转。
     b.沿比较慢的话，信号之间时序配合上会有问题，不同器件的判断电平点不同，导致即使同一信号在不同IC上产生的逻辑沿时间不同。
     c. ic921说的，沿慢，交叉功耗大。

个人意见。

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13楼
iC921| | 2011-2-14 09:21 | 只看该作者
有意做是不是还与制造难度有关？

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14楼
zhouyu2576| | 2011-2-14 10:36 | 只看该作者
信号下降沿比上升沿会快一点 工艺决定的

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15楼
kubuco|  楼主 | 2011-2-14 18:26 | 只看该作者
对921提的功耗什么的不大明白。。有人来讲解下吗？

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16楼
iC921| | 2011-2-14 19:16 | 只看该作者
功耗在书上也讲得挺明白，输出口就是高低电平转换过程中，原来导通的管子和将要关闭的管子不能实行先关闭后接通，而总有一个同时导通的过程——在这一过程中，电流很大……不记得这个电流叫什么了

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17楼
iC921| | 2011-2-14 19:23 | 只看该作者
补充：显然，同时导通的时间越长，电能消耗越大

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18楼
kubuco|  楼主 | 2011-2-16 09:19 | 只看该作者
基本明白了。欢迎大家补充。。于博士的信号完整性讲得还真不错。。

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19楼
ghost1325| | 2011-2-16 11:54 | 只看该作者
信号下降沿比上升沿会快一点 工艺决定的
zhouyu2576 发表于 2011-2-14 10:36


这个不一定吧

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