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高速信号中，串接电阻问题

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Hu.Te|  楼主 | 2011-2-16 10:19 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式
信号, 电阻, 高速信号, DDR, 终端
高速信号中，串接电阻是靠近源端好，还是终端好？
以DDR设计为例

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来自 2楼
Hu.Te|  楼主 | 2011-2-16 12:48 | 只看该作者
在信号源端阻抗低于传输线特征阻抗的条件下，在信号的源端和传输线之间串接一个电阻R，使源端的输出阻抗与传输线的特征阻抗相匹配，抑制从负载端反射回来的信号发生再次反射
拿出反射的公式来：
Pl=(Rl-Zo)/(Rl+Zo) 终端
ps=(Ro-Zo)/(Ro+Zo) 源端

根据反射的计算公式，确实有此特性。
红色的字所说的前提确实很重要的，阻抗之间的关系

这个说明更有点说服力的。但这也只是理论上！有些还是要根据实际出发的，驱动力，拓扑结构！
加不加这个电阻，根据实际使用环境的。其实DDRx上很少看到串接此电阻，特别是在DDR2/DDR3上的

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板凳
vbcity| | 2011-2-16 10:30 | 只看该作者
一般现在的SOC芯片内部都有阻抗电阻设置的。在设计DDR的时候更多的考虑的是线长的问题。

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地板
Hu.Te|  楼主 | 2011-2-16 10:35 | 只看该作者
:)
话是没错的，但是我还是想知道原因的。
实际中，特别是板载设计，串接电阻一般不接的，直接接并接的的终端电阻
如果说此串联电阻靠近源端比终端更有实际意义，理由是什么？

vbcity

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5楼
shgxx015| | 2011-2-16 11:48 | 只看该作者
当然是靠近源端比较好了啊，这还用问啊

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6楼
ghost1325| | 2011-2-16 11:53 | 只看该作者
从EMC角度考虑，源端比终端有意义

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7楼
chunyang| | 2011-2-16 18:43 | 只看该作者
楼上说的不错，还给出了公式，加酷以示鼓励！

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8楼
雪山飞狐D| | 2011-2-17 14:27 | 只看该作者
本帖最后由 雪山飞狐D 于 2011-2-17 14:30 编辑

LZ忽略一个问题，信号源端阻抗低于传输线特征阻抗的条件下，当源端到阻抗控制线这段距离很短情况下（实际也短），反射回波最终稳定时间远比信号上升时间短很多，实际这段微距可以不看做传输线

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9楼
china_tongxin| | 2011-2-17 14:37 | 只看该作者
学习中。。。。。

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10楼
nongfuxu| | 2011-2-17 16:01 | 只看该作者
一般
    源端,输出端阻抗小,串接;
      末端,输入端阻抗大,到地并接.
更多什么都不接,近距离.

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11楼
Hu.Te|  楼主 | 2011-2-18 15:10 | 只看该作者
8# 雪山飞狐D
能够理解你提出的这一观点,其实这个串接也是有前提存在的,只是没有涉及到这一方面,
终端的匹配也是要做好的

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12楼
sxhhhjicbb| | 2011-2-19 22:51 | 只看该作者
一般是加在源端.不知道为什么.学习了.

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13楼
nongfuxu| | 2011-2-20 09:13 | 只看该作者
信号源--->传输线--->信号接收.
一般传输线的阻抗在50~100欧姆.
2个阻抗匹配地点:  传输的起点和终点.

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14楼
baoxiaochen| | 2011-2-22 20:32 | 只看该作者
已经结了帖子
还可以回复么

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15楼
chunyang| | 2011-2-22 20:42 | 只看该作者
结贴和是否可以回复无关。

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16楼
czy783201| | 2011-2-24 13:30 | 只看该作者
加在源端，我们的产品也是这样的

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17楼
jiepeng| | 2011-3-9 10:49 | 只看该作者
学习了

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18楼
Hu.Te|  楼主 | 2011-3-16 13:23 | 只看该作者
这个是自己遇到一些问题，拿出来看看大家对此的看法了！
或许自己当初并没有完全理解，只是站在纯经验的角度上的

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19楼
jack_shine| | 2011-3-22 14:36 | 只看该作者
路过学习~~~

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20楼
robin.luo| | 2011-3-23 13:31 | 只看该作者
个人认为，要看拓扑结构：
1、点对点，在源端串联电阻匹配；
2、点对多点----星形拓扑时，在每个分支上串联电阻匹配；
           ----菊花链拓扑时，在最后一个终端并联电阻匹配；

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