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求教，xilinx Spartan6 map出错

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楼主
chenqinte|  楼主 | 2011-3-3 17:31 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式
spartan6, XILINX, IO, AC, 器件

根据报告的提示是说IO绑定过多，超出了器件的IO数目。
但是我连接的IO只有96个，还有几个管脚时悬空没有连接的。
不知道为什么会出现这样的错误，请大家解惑，谢谢。

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沙发
atua| | 2011-3-4 08:52 | 只看该作者
有完整的实现报告吗？

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dan_xb| | 2011-3-4 10:13 | 只看该作者
UCF贴出来看看？

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SuperX-man| | 2011-3-4 11:05 | 只看该作者
楼主的顶层文件是不是描述了所有要连接到IO的信号.但是在UCF中并没有全部连接起来?

在MAP的时候是会以你顶层定义的为准,但是绑定是按照UCF来的.
建议你重新加一个顶层文件,把你需要的引出来.然后再综合看看

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5楼
龙芯一号| | 2011-3-4 11:34 | 只看该作者
继续关注

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6楼
chenqinte|  楼主 | 2011-3-4 18:24 | 只看该作者
楼上几位说的我都看过了，UCF与顶层定义的信号完全一致，不多不少

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7楼
SuperX-man| | 2011-3-4 19:44 | 只看该作者
小版我的意思是,不是你UCF中多了或者少了,而是在你综合的时候会根据你的顶层文件来推算你需要的IO数.
所以会在MAP中报错,你试试看再加一个顶层,把要连的拿出来,再综合做下去,是否可以解决

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8楼
明空| | 2011-3-5 00:24 | 只看该作者
斑竹的意思是说你在HDL文件里定义了其他的IO，但是没有在UCF中进行约束，

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9楼
chenqinte|  楼主 | 2011-3-6 09:27 | 只看该作者

verilog 大小写

查出问题了，我用verilog写的，代码从之前的项目移植过来，重新做了IO管脚定义，结果是用小写，代码都是用大写的。

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