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verilog乘法、除法器

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沙发
sxhhhjicbb| | 2011-5-18 20:03 | 只看该作者
和不同的编译器有关,你自己对比一下,看花费的资源划不划算。

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板凳
shuiyangyang| | 2011-5-19 23:12 | 只看该作者
固定整数的乘法转换成加法进行。除法的话,可以直接使用除号让综合器生成。时序不满足,在手动例化除法IP

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