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ise 仿真没输出信号量 求帮忙 最好能给个 testbench 文件

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a5612433|  楼主 | 2011-5-26 16:51 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式
仿真, se, 输出信号, testbench, ge
module div_clk6mhz(clk24m,clk6m);//6Mz的基准频率
input clk24m;
output clk6m;
reg clk6m;
reg cnt;
[email=always@(posedge]always@(posedge[/email] clk24m)
if(cnt<1)cnt=cnt+1;      
   else
   begin
      cnt=0;
     clk6m=~clk6m;
   end
endmodule

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