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[FPGA] FPGA的输出全部为高

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 楼主| 平漂流 发表于 2017-11-12 22:40 | 显示全部楼层 |阅读模式
FPGA, altera, LTE, Quartus, UART
画了一个FPGA的应用板，altera的，TQFP144封装的。用一个简单的分频程序，quartus显示程序下载完成，但是输出全为高，求大神指导
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thinkabout4451 发表于 2017-11-17 13:20 | 显示全部楼层
未使用管脚配置成高阻输入态看看
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