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请教关于晶振给fpga提供时钟的问题

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mobaimo|  楼主 | 2011-6-5 14:45 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式
FPGA, 时钟, 晶振, 正弦波, 电路
今天在调试spatan3e xc3s500的时候，由于电路不能正常工作。我就用示波器检测外部晶振，然后看到外部晶振产生的是正弦波，但是它的最低幅值为0.7v左右。最高为1.7v左右。请问这是不是不能正常给fpga提供时钟啊，我觉得是不是时钟的最低幅值都很高了啊，请大家帮帮忙啊。谢谢

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沙发
AutoESL| | 2011-6-5 20:48 | 只看该作者
帮顶

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板凳
dan_xb| | 2011-6-9 15:47 | 只看该作者
如果你的电源是3.3V的话，并且你的晶振是那种一般的4个脚的晶振的话，这个晶振就是坏的，换一个
你是插件的那种还是贴片的？

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地板
mobaimo|  楼主 | 2011-6-10 13:43 | 只看该作者
是的，我用的电源就是3.3v的，下来看了datesheet后看到fpga的全局时钟管脚的驱动电压的低电平最高是0.7v。最后我把晶振去除后，直接接上实验箱上的方波时钟后FPGA就可以正常工作了。

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5楼
钻研的鱼| | 2011-6-11 08:34 | 只看该作者
时钟频率不高，输出一般是方波，较高的频率，很多是正弦波。波形的测量，也与你示波器的带宽相关

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6楼
amini| | 2011-6-15 22:11 | 只看该作者
学习了。留印。

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7楼
wahahaabc| | 2011-6-20 08:40 | 只看该作者
5# 钻研的鱼
同意鱼哥的说法

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8楼
coco11| | 2011-6-20 17:04 | 只看该作者
学习学习。

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9楼
kangkai1222| | 2011-7-7 16:56 | 只看该作者
过来留下学习的脚印

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10楼
GoldSunMonkey| | 2011-7-7 20:39 | 只看该作者
;P

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11楼
ssdw| | 2011-7-7 22:53 | 只看该作者
留个脚印哈

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12楼
ssdw| | 2011-7-7 22:53 | 只看该作者
:lol

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13楼
greenapl1985| | 2011-7-19 20:10 | 只看该作者
不可以，FPGA芯片引脚的驱动电压是3.3V或2.5V

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14楼
GoldSunMonkey| | 2011-7-19 20:53 | 只看该作者
13# greenapl1985 看四楼，他还说了最低电平的事情：）

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15楼
dolido| | 2011-7-20 14:49 | 只看该作者
这么多人留脚印了呀

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16楼
dolido| | 2011-7-20 14:49 | 只看该作者
我也凑凑热闹哈

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17楼
星星之火红| | 2011-7-20 20:31 | 只看该作者
。。。天。我来玩了～～

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18楼
HAORANAN123| | 2011-8-29 21:28 | 只看该作者
我也遇到这样问题，与你示波器带宽有关，应该是方波。

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19楼
chaiwq2003| | 2011-9-4 20:51 | 只看该作者
怀疑是你的晶振有问题，我使用XC3S250E，30MHz &3.3V供电的有源晶振，使用示波器测量晶振输出信号为正弦波

目前用过的晶振输出一般都是正弦波，而不是方波信号！

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20楼
brace1108| | 2012-4-6 17:55 | 只看该作者
弱弱的问一个问题，晶振输出的是正弦波，而在FPGA工作是需要上升沿或是下降沿，那么在晶振输入到内部电路后要把它变成方波吗？ 19# chaiwq2003

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