64
967
3021
中级工程师
使用特权
12
925
3231
版主
144
1720
6161
高级工程师
0
211
636
高级技术员
444
1359
助理工程师
33
455
1687
470
1422
510
1546
282
909
224
681
从信号完整性来讲,我知道是这种情况。 我的主要问题是:fpga在读外面的ddr2颗粒数据时,会根据这个信号去锁存数据信号,我记得在spartan3里面会用dqs的沿去锁数据。当第一个数据有效时,dqs由中间电平转为低电平 ... 钻研的鱼 发表于 2011-6-17 16:37
spartan6 memory control.pdf
2011-6-21 15:56 上传
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