请教64位的计数器verilog 程序怎么写?

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 楼主| xiaoyu9632 发表于 2007-11-20 09:54 | 显示全部楼层 |阅读模式
一般都做8位和16位的,现在要做64位的,我一时间觉得不会写,有谁先能告诉我呀。
xwj 发表于 2007-11-20 10:02 | 显示全部楼层

会写8位的还不会写64位的?

没动脑筋吧?
 楼主| xiaoyu9632 发表于 2007-11-20 10:28 | 显示全部楼层

汗!

写8位的比较简单,最大计数也只有256而已,我现在是64位计数器,32位总线输出,数值比较大,而我用的芯片是EPM7128,我不知道会出现什么问题或者有些什么因素需要我考虑,经验欠缺,贴个代码吧,虽然感到惭愧,但希望各位不要见笑,我只是个菜鸟。<br />/***********ADDRESS&nbsp;DECODER***************<br />&nbsp;&nbsp;&nbsp;&nbsp;&nbsp;&nbsp;Input:&nbsp;&nbsp;global&nbsp;clk;<br />&nbsp;&nbsp;&nbsp;&nbsp;Output:&nbsp;data_out[31:0];<br />***************************************/<br />module&nbsp;Bit_64count(clk,data_out);<br />input&nbsp;clk;<br />output&nbsp;[31:0]&nbsp;data_out;<br />reg&nbsp;[31:0]&nbsp;data_out;<br />reg[63:0]&nbsp;Bit_count;<br />reg&nbsp;Cnt_flag&nbsp;;<br /><br />always&nbsp;&nbsp;@(clk)<br />begin<br />&nbsp;&nbsp;&nbsp;&nbsp;Cnt_flag&nbsp;&lt=&nbsp;Cnt_flag&nbsp;==&nbsp;1?&nbsp;0:1;<br />&nbsp;&nbsp;&nbsp;&nbsp;if(!Cnt_flag)<br />&nbsp;&nbsp;&nbsp;&nbsp;begin<br />&nbsp;&nbsp;&nbsp;&nbsp;&nbsp;&nbsp;&nbsp;&nbsp;Bit_count&nbsp;&lt=&nbsp;Bit_count&nbsp;+&nbsp;1;<br />&nbsp;&nbsp;&nbsp;&nbsp;&nbsp;&nbsp;&nbsp;&nbsp;data_out&nbsp;&lt=&nbsp;Bit_count[31:0];<br />&nbsp;&nbsp;&nbsp;&nbsp;end<br />&nbsp;&nbsp;&nbsp;&nbsp;else<br />&nbsp;&nbsp;&nbsp;&nbsp;&nbsp;&nbsp;&nbsp;&nbsp;data_out&nbsp;&lt=&nbsp;Bit_count[63:32];<br />end&nbsp;<br />&nbsp;&nbsp;&nbsp;&nbsp;<br />endmodule
 楼主| xiaoyu9632 发表于 2007-11-20 14:13 | 显示全部楼层

没有人回答么

怎么没人原意回答呢?
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