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关于modelsim后仿真的问题

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钻研的鱼|  楼主 | 2011-6-27 08:54 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式
在用modelsim做后仿真时,由于时钟的相位是动态调整的,因此在用时钟去锁存外部的数据时,会不满足setup/hold时间,这时modelsim仿真会出现问题,内部的信号会有stx状态,导致后面的逻辑出错。本来的设计本意是即使出现不稳定的时候也会通过调整时钟相位,达到数据稳定,即modelsim不要出现stx状态,是0或者1都可以,保证逻辑不会混乱,有没有设置可以避免这种情况?

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沙发
GoldSunMonkey| | 2011-6-27 11:49 | 只看该作者
我印象中,这个设置中没有办法实现。能不能代码中避免这个情况?

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板凳
AutoESL| | 2011-6-27 15:07 | 只看该作者
围观

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地板
jennyzheng| | 2011-6-29 14:14 | 只看该作者
帮顶~

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GoldSunMonkey| | 2011-6-29 14:24 | 只看该作者
。。。。怎么没人给我提供更详细的信息呢?

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钻研的鱼|  楼主 | 2011-7-1 17:42 | 只看该作者
不采用后仿,直接使用功能仿真,就没这个问题了

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7
AutoESL| | 2011-7-9 14:30 | 只看该作者
学习了

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8
GoldSunMonkey| | 2011-7-9 16:47 | 只看该作者
6# 钻研的鱼
前仿真正确只能证明功能正确。

还是你的代码的同步风格太差了~

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9
钻研的鱼|  楼主 | 2011-7-10 15:13 | 只看该作者
我是用xilinx的源码做仿真。
本来就是做时间调整的,用dcm的可变相位模式,肯定有不稳定状态,我希望着不稳定状态是1或者0都可以,但不要是x状态

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10
GoldSunMonkey| | 2011-7-11 12:45 | 只看该作者
9# 钻研的鱼 这个我没用过,不敢轻易发表言论。
有知道的兄弟么??

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11
SuperX-man| | 2011-7-11 17:50 | 只看该作者
这个应该不是仿真工具的设置问题吧.
modsim只是根据仿真代码执行而已.要避免这个,需要你自己改设计的

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GoldSunMonkey| | 2011-7-11 19:57 | 只看该作者
:)和我说的一样~

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jayy| | 2011-7-11 21:26 | 只看该作者
不愧为版主呀

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14
jayy| | 2011-7-11 21:26 | 只看该作者
:handshake

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flyfpga| | 2011-7-11 21:46 | 只看该作者
关注中

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GoldSunMonkey| | 2011-7-12 14:57 | 只看该作者
;P是夸我还是夸X-MAN?

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钻研的鱼|  楼主 | 2011-7-12 15:03 | 只看该作者
都是xilinx的人,一家的

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GoldSunMonkey| | 2011-7-12 16:09 | 只看该作者
;P哈哈~~

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rulu| | 2011-7-13 16:43 | 只看该作者
赛灵思大家庭

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rulu| | 2011-7-13 16:44 | 只看该作者
;P

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