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如何知道PLL的锁定范围？

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leafing|  楼主 | 2011-7-1 18:03 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式
PLL, 倍频, ck
用的V6 760，100M clockin, 2 倍频，我怎样知道PLL输入频率的范围？

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沙发
AutoESL| | 2011-7-1 18:46 | 只看该作者
不知道，应该有文档说明吧

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板凳
leafing|  楼主 | 2011-7-1 19:01 | 只看该作者
输出的频率多种多样，不可能每一种频率的输入范围都一样，感觉可能在report里面

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地板
longley| | 2011-7-1 22:27 | 只看该作者
具体参见V6的datasheet，输入范围跟MMCM的属性设置有关，建议用core gen生产

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5楼
dolido| | 2011-7-2 10:08 | 只看该作者
这个文档有呀

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6楼
dolido| | 2011-7-2 10:08 | 只看该作者
:lol

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7楼
leafing|  楼主 | 2011-7-2 10:33 | 只看该作者
请明示，感谢！

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8楼
figi| | 2011-7-3 11:02 | 只看该作者
等结果呀

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9楼
figi| | 2011-7-3 11:02 | 只看该作者
:handshake

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10楼
GoldSunMonkey| | 2011-7-3 11:34 | 只看该作者
1# leafing
你是指MMCM的范围么？？

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11楼
leafing|  楼主 | 2011-7-3 17:49 | 只看该作者
是的，比方说我设置100M 输入，2倍频，那么是不是所有频率进都可以2倍频还是说有一个范围，如果有，那范围是多少？

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12楼
GoldSunMonkey| | 2011-7-3 17:55 | 只看该作者
最后一次论坛解决，不然你给我打电话吧，我还是没太看明白。

你是指100MHZ这个时钟是不是有范围？对吧？

如果是那么就是10MHZ~750MHZ，

不过，是在看不明白为什么会有V6 760的概念？这是什么概念？

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13楼
leafing|  楼主 | 2011-7-4 09:55 | 只看该作者
12# GoldSunMonkey 感谢，是的，虽然我在core generate里面那么设置了，但是其实我的输入频率是有范围的，因为测试要输入不同的频率，担心输入频率变了，PLL锁不住，另我实在不知道你的联系方式

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14楼
GoldSunMonkey| | 2011-7-4 10:59 | 只看该作者
输入频率的范围是10MHZ～750MHZ， 但是时钟变换需要一定的稳定的时间。

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15楼
leafing|  楼主 | 2011-7-4 16:32 | 只看该作者
输入频率的范围是10MHZ～750MHZ， 但是时钟变换需要一定的稳定的时间。
GoldSunMonkey 发表于 2011-7-4 10:59

十分感谢，看来xilinx的PLL的确要比altera的好一些，altera的还有输入范围限制

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16楼
明空| | 2011-7-5 00:09 | 只看该作者
最后一次论坛解决，不然你给我打电话吧，我还是没太看明白。

你是指100MHZ这个时钟是不是有范围？对吧？

如果是那么就是10MHZ~750MHZ，

不过，是在看不明白为什么会有V6 760的概念？这是什么概念？ ...
GoldSunMonkey 发表于 2011-7-3 17:55

他说的是XC6VLX760T吧

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17楼
kekeke| | 2011-7-6 16:28 | 只看该作者
可能是

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18楼
kekeke| | 2011-7-6 16:28 | 只看该作者
:handshake

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19楼
leafing|  楼主 | 2011-7-6 19:26 | 只看该作者
16# 明空 是的

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20楼
dan_xb| | 2011-7-7 14:16 | 只看该作者
还有一个限制，是内部VCO的频率，你要通过分频倍频比，算一下内部VCO的频率是多少
查找一下芯片手册，上面写的有VCO的频率范围

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