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ISE问题求助

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楼主
caiys|  楼主 | 2011-7-20 09:41 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式
se, AC, ST, TE, TEST
在ISE10.1中进行行为(功能)仿真新建source有个test bench waveform如下图，可我现在用的是ISE12.3的，找不到test bench waveform,我该到哪去找呢？

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AutoESL| | 2011-7-20 12:19 | 只看该作者
帮顶

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板凳
SuperX-man| | 2011-7-20 13:17 | 只看该作者
12版本中已经没有了test bench waveform这种方式了.统一使用VHDL/Verilog Test bench

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地板
caiys|  楼主 | 2011-7-20 13:24 | 只看该作者
楼上的大哥，我没看到VHDL/Verilog Test bench只看到了VHDL Test bench可是我用的是verilog语言啊。怎么回事？

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5楼
GoldSunMonkey| | 2011-7-20 15:20 | 只看该作者
楼上的签名档很让我佩服，不过我觉得这种精神需要加强。这个问题还是我来回答你

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6楼
星星之火红| | 2011-7-20 20:29 | 只看该作者
大圣V5~

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7楼
figi| | 2011-7-20 20:37 | 只看该作者
版主很强悍啊

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8楼
figi| | 2011-7-20 20:37 | 只看该作者
:P

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9楼
caiys|  楼主 | 2011-7-21 09:45 | 只看该作者
大家在笑话我，我刚开始学

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10楼
dan_xb| | 2011-7-23 22:58 | 只看该作者
楼上的大哥，我没看到VHDL/Verilog Test bench只看到了VHDL Test bench可是我用的是verilog语言啊。怎么回事？70048
caiys 发表于 2011-7-20 13:24

就是那个Verilog Test Fixture

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11楼
星星之火红| | 2011-7-23 23:36 | 只看该作者
;P大圣回答了。哈哈～～

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12楼
lelee007| | 2011-7-24 15:35 | 只看该作者
:lol

verilog test fixture

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13楼
GoldSunMonkey| | 2011-7-24 22:39 | 只看该作者
;P我都回答了

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