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静电泄放路径

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 楼主| junliangshen 发表于 2018-4-3 15:50 | 显示全部楼层 |阅读模式
PCB, pcb板, 电池, 静电测试, 供电
各位大神好，最近我们产品硅麦在做静电测试时（测试条件：采用电池供电产品（2.75v）,+—8KV，25次，每打一次，然后用静电刷扫一次）发生失效，经分析，不良位置多集中在OUT-和VDD端，并且多发生在PCB板中埋阻位置，关于静电的泄放路径有点想不明白？为什么总是这个断口发生不良？
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chunyang 发表于 2018-4-3 20:28 | 显示全部楼层
说明该回路是相对阻抗最低的。ESD防护除采用防护元件外，还要讲究PCB设计。
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