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为进一步推进赛灵思的即插即用 IP 计划，ISE 13.2 设计套件在 CORE Generator™ 系统中提供了 AXI(Advance eXtensible Interface) 互联支持，以构建性能更高的点对点架构。设计团队如果构建了自己的符合 AXI 协议的 IP ，那么就能利用可选的 AXI BFM（总线功能模型）验证 IP 来仿真 AXI 互联协议，从而可轻松确保所有接口事件处理都能正确运行（参见《用户指南：AXI 总线功能模型v1.1》）。AXI BFM 目前在 ISim 以及 Cadence、Mentor 和 Synopsys 等仿真器中可用。用户现在还能在面向 Virtex-6和 Spartan-6 FPGA 的设计中通过嵌入式开发套件来访问 AXI_PCIe 核。此外，嵌入式开发套件中的 ChipScope™ AXIMonitor 核还能监控 AXI3 接口，并提供可选的 AXI 协议检查器。AXI 协议检查器围绕 ARM SystemVerilog Assertions（SVA）而设计，可支持 39 个 Ready/Valid 握手协议检查 |
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