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[VHDL]

vhdl ‘stable 函数 以及 ’delayed函数 无效

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楼主
syongy135|  楼主 | 2018-4-15 17:44 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式
请教vhdl 高手: 本人按着《vhdl编程实例l》教科书 设计的范例 验证 ‘stable 函数 以及 ’delayed函数  通过仿真验证 以上两个函数无效, 请教问题的原因?解决办法?
library ieee;
use ieee.std_logic_1164.all;
entity pulse_gen is
port(a:in std_logic;
          b:out boolean);
end;
architecture one of pulse_gen is
begin
b<= a'stable (15ns);
  end  ;
评论
ucx 2018-4-15 23:26 回复TA
给输入a接入一个20M的方波信号,就可以看出仿真的效果了 

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沙发
ucx| | 2018-4-15 23:38 | 只看该作者
如果学习VHDL语言,目的不是为了研究语言本身,那么这类稍微复杂一点的纯仿真语句完全没有必要知道。

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板凳
sxhhhjicbb| | 2018-4-16 09:11 | 只看该作者
要综合的描述中,不要用 function,用task

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