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H.264视频编解码低延迟xilinx Zynq系列FPGA解决方案资源占比详图

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本帖最后由 yinyidianzi 于 2018-6-25 12:22 编辑

银亿电子以逻辑语言为基础编写的H.264视频编解码,以IP核的形式,在FPGA器件上运行,基于FPGA的解决方案使用FPGA为核心器件,实现H.264编解码的IP核,此解决方案为纯硬件的解决方案,启动时间可以忽略,编码延迟为0.5ms,以下为H.264视频编解码低延迟xilinx Zynq系列FPGA解决方案资源占比详图:
H.264 IP core特点及性能介绍.pdf (132.7 KB)



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