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初级技术员
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高级技术员
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2018-8-1 23:11 上传
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Vansm 发表于 2018-8-1 23:12 帮助新人,既是责任也是义务。哎~~~~
877049204 发表于 2018-8-2 08:59 楼主是04年的老前辈。。。
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中级工程师
971175b62888fbb076.png (21.5 KB )
2018-8-2 12:29 上传
QUESTION.PNG (22.29 KB )
2018-8-2 12:21 上传
Vansm 发表于 2018-8-2 09:12 还真是老前辈 没注意看
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2万
技术总监
gx_huang 发表于 2018-8-2 12:58 你这个电路,欠考虑呀
suntop 发表于 2018-8-2 12:32 多谢大虾了。发帖后我自己搭了一下,如图所示,看来还是你的要简单点
chongdongchen 发表于 2018-8-2 10:08 这个图当V3大于V1,比如12V和5V,就不行了吧。 另外还有倒灌的问题。
]620[VR4TK%1RZ~ID@PMQ1H.png (179.23 KB )
2018-8-2 14:16 上传
Vansm 发表于 2018-8-2 13:55 (目前的逻辑是:当V1=5V时,Vout=V1, 当V1=0V时,Vout=V3), 这句话说错了把 应该是Vout = V2吧 ...
Vansm 发表于 2018-8-2 13:58 V2后面的PMOS的栅极因该加个上拉电阻
suntop 发表于 2018-8-2 14:20 我的意思是V2=V1,所以V1=5V时,相当于Vout=V1了
Vansm 发表于 2018-8-2 14:24 没太明白啊
422235b62a640238ec.png (23.03 KB )
2018-8-2 14:35 上传
suntop 发表于 2018-8-2 14:37 还是用图来说话清楚点:V2改成V1了,所以逻辑是V1=5V时(此时V3=5.2V左右),Vout=V1;V1=0V时(此时V3=5.2V左 ...
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中级技术员
Vansm 发表于 2018-8-2 14:16 有道理 故改之
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