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想用几个MOS管实现一个选择不同电压源的电路,不知道怎么搭

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楼主
suntop|  楼主 | 2018-8-1 11:52 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式
沙发
dirtwillfly| | 2018-8-1 21:03 | 只看该作者
这个容易啊,楼主参考下触发器就可以
在数字电子技术课本里就有

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板凳
Vansm| | 2018-8-1 23:12 | 只看该作者


帮助新人,既是责任也是义务。哎~~~~

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dirtwillfly 2018-8-2 21:06 回复TA
这个更简洁 
地板
877049204| | 2018-8-2 08:59 | 只看该作者
Vansm 发表于 2018-8-1 23:12
帮助新人,既是责任也是义务。哎~~~~

楼主是04年的老前辈。。。

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5
Vansm| | 2018-8-2 09:12 | 只看该作者
877049204 发表于 2018-8-2 08:59
楼主是04年的老前辈。。。

还真是老前辈  没注意看

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6
chongdongchen| | 2018-8-2 10:08 | 只看该作者
Vansm 发表于 2018-8-1 23:12
帮助新人,既是责任也是义务。哎~~~~

这个图当V3大于V1,比如12V和5V,就不行了吧。
另外还有倒灌的问题。

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chongdongchen 2018-8-2 10:10 回复TA
V2那PMOS也存在不稳定情况 
7
suntop|  楼主 | 2018-8-2 12:32 | 只看该作者
Vansm 发表于 2018-8-1 23:12
帮助新人,既是责任也是义务。哎~~~~

多谢大虾了。发帖后我自己搭了一下,如图所示,看来还是你的要简单点



现在有个新问题,其实V2就是V1,(目前的逻辑是:当V1=5V时,Vout=V1, 当V1=0V时,Vout=V3),V3有可能会到5.2V,那会不会有可能出现我图中的Q1,Q2同时导通的情况,这样V1和V3不就接在一起了?(比如V1>0,同时V1又小于V3,当然V1的理论情况是要么0V,要么5V)


多谢

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8
suntop|  楼主 | 2018-8-2 12:34 | 只看该作者
877049204 发表于 2018-8-2 08:59
楼主是04年的老前辈。。。

那是我一个朋友的帐号,我拿过来用的

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9
suntop|  楼主 | 2018-8-2 12:35 | 只看该作者
Vansm 发表于 2018-8-2 09:12
还真是老前辈  没注意看

朋友的帐号,他从来不用的

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10
gx_huang| | 2018-8-2 12:58 | 只看该作者
Vansm 发表于 2018-8-1 23:12
帮助新人,既是责任也是义务。哎~~~~

你这个电路,欠考虑呀

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11
Vansm| | 2018-8-2 13:52 | 只看该作者
gx_huang 发表于 2018-8-2 12:58
你这个电路,欠考虑呀

总监快给指点一下

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12
Vansm| | 2018-8-2 13:55 | 只看该作者
suntop 发表于 2018-8-2 12:32
多谢大虾了。发帖后我自己搭了一下,如图所示,看来还是你的要简单点

(目前的逻辑是:当V1=5V时,Vout=V1, 当V1=0V时,Vout=V3),   这句话说错了把   应该是Vout = V2吧

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13
Vansm| | 2018-8-2 13:58 | 只看该作者
gx_huang 发表于 2018-8-2 12:58
你这个电路,欠考虑呀

V2后面的PMOS的栅极因该加个上拉电阻  

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14
Vansm| | 2018-8-2 14:16 | 只看该作者
chongdongchen 发表于 2018-8-2 10:08
这个图当V3大于V1,比如12V和5V,就不行了吧。
另外还有倒灌的问题。

有道理 故改之

]620[VR4TK%1RZ~ID@PMQ1H.png (179.23 KB )

]620[VR4TK%1RZ~ID@PMQ1H.png

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suntop|  楼主 | 2018-8-2 14:20 | 只看该作者
Vansm 发表于 2018-8-2 13:55
(目前的逻辑是:当V1=5V时,Vout=V1, 当V1=0V时,Vout=V3),   这句话说错了把   应该是Vout = V2吧 ...

我的意思是V2=V1,所以V1=5V时,相当于Vout=V1了

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16
suntop|  楼主 | 2018-8-2 14:20 | 只看该作者
Vansm 发表于 2018-8-2 13:58
V2后面的PMOS的栅极因该加个上拉电阻

你是说我的吗?

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17
Vansm| | 2018-8-2 14:24 | 只看该作者
suntop 发表于 2018-8-2 14:20
我的意思是V2=V1,所以V1=5V时,相当于Vout=V1了

没太明白啊

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18
suntop|  楼主 | 2018-8-2 14:37 | 只看该作者

还是用图来说话清楚点:V2改成V1了,所以逻辑是V1=5V时(此时V3=5.2V左右),Vout=V1;V1=0V时(此时V3=5.2V左右),Vout=V3.

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19
Vansm| | 2018-8-2 14:48 | 只看该作者
suntop 发表于 2018-8-2 14:37
还是用图来说话清楚点:V2改成V1了,所以逻辑是V1=5V时(此时V3=5.2V左右),Vout=V1;V1=0V时(此时V3=5.2V左 ...

明白了  所以你这个电路就不太对 参考我后来发那个电路吧  考虑了防止倒灌  不过会有一个二极管的压降

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20
plplpo| | 2018-8-2 15:13 | 只看该作者
Vansm 发表于 2018-8-2 14:16
有道理 故改之

请教前辈,V1高电平时,若V3>V1,与V3相连的第一个PMOS的寄生二极管是不是会导通,从而在电阻上产生上+下-的压降,导致PMOS开启?这样的话V3这一路不是就误导通了吗?

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