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FPGA芯片资源利用率可以达到100%吗？

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AutoESL|  楼主 | 2011-8-7 18:34 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式
FPGA芯片, 时序, 时序收敛
本帖最后由 AutoESL 于 2011-9-30 15:34 编辑

曾经达到过98%，最后时序收敛是个极大的挑战。

理论上应该可以达到100%吧？

大家常用的项目都用到什么比例呢？

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沙发
钻研的鱼| | 2011-8-7 19:10 | 只看该作者
没设计过这么复杂的，一般只用到60%左右

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板凳
lianshumou| | 2011-8-7 19:59 | 只看该作者
基本不可能用到100%
用到了100%的项止说明你芯片选择不合理

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地板
atua| | 2011-8-8 09:12 | 只看该作者
"资源利用率"是指LUT资源吧？FPGA片内的资源还包括DSP、Memory、PLL（DLL）以及各种硬核资源模块，还真没看见过哪个设计可以把这些资源都利用上的:)

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5楼
明空| | 2011-8-8 10:19 | 只看该作者
DSP、Memory、PLL（DLL）很容易100%

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6楼
atua| | 2011-8-8 12:44 | 只看该作者
DSP、Memory、PLL（DLL）很容易100%
明空 发表于 2011-8-8 10:19


LUT、DSP、Memory、PLL（DLL）呢？

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7楼
dan_xb| | 2011-8-8 14:03 | 只看该作者
LUT一般不会100%，否则没法布线了

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8楼
AutoESL|  楼主 | 2011-8-8 16:54 | 只看该作者
正常来说,利用率是多少算是芯片选择比较合理呢
既不浪费,也够用

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9楼
atua| | 2011-8-9 09:23 | 只看该作者
现在所有的FPGA芯片的产品系列对可用资源来说都是离散的，而每个设计又是随设计目标、开发人员经验、项目进度要求、成本控制，以及对特定资源的需求等若干原因而千变万化，所以很难说一个项目的芯片利用率达到多少就合理，我的理解是：用小一级的芯片可能会耽误进度、或降低的成本与潜在风险不成比例时所选的芯片就是合理的

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10楼
GoldSunMonkey| | 2011-8-9 18:39 | 只看该作者
看自己怎么说，怎么选择了。

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