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[FPGA] 同步fifo的读写使能问题

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 楼主| 平漂流 发表于 2018-8-8 09:05 | 显示全部楼层 |阅读模式
FIFO, 读写, 同步FIFO, Global, 电平
如图，我的写fifo是间断的一个一个写进去的，写使能高电平是一个global_clk(与下图不一样，图是在网上找的，借图说话)。可以把FIFO_clk反相一下吗?

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蒋哈哈 发表于 2018-11-24 18:50 | 显示全部楼层
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jianzhimail501 发表于 2018-11-24 20:46 来自手机 | 显示全部楼层
fifo写的时候使能和数据一起给，读要提前一个周期给使能
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