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430G2231 ACLK SMCLK输出问题

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jlyuan|  楼主 | 2018-8-9 17:37 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式
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dengdc| | 2018-8-9 17:40 | 只看该作者

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jlyuan|  楼主 | 2018-8-9 17:43 | 只看该作者
源代码如下
#include "io430.h"
#include "io430G2231.h"

int main( void )
{
  // Stop watchdog timer to prevent time out reset
  WDTCTL   =   WDTPW + WDTHOLD;
  DCOCTL   =   DCO0  + DCO1;  //+ DCO2;                //设置DCO=7
  BCSCTL1 &= ~(RSEL0 + RSEL1 + RSEL2 + RSEL3);         //设置RSEL=0,DCO设置为120KHz
  BCSCTL1 &= ~ XTS;                                    //设置LFXT1进入低频模式(VLO使用前提条件)
  BCSCTL1 |=   XT2OFF;                                 //关闭XT2
  BCSCTL2 &= ~(SELM0 + SELM1);                         //设置 MCLK来源于DCO
  BCSCTL2 &= ~ SELS;                                   //设置SMCLK来源于DCO
  BCSCTL2 |=   DIVS0 + DIVS1;                          //设置SMCLK 8分频
  BCSCTL3 |=   LFXT1S1;                                //使用 VLO
  BCSCTL3 &= ~ LFXT1S0;
  P1DIR   |=   P0 + P4;                                //设置P1.0 1.4为输出
  P1SEL   |=   P0 + P4;                                //设置P1.0输出ACLK,P1.4输出SMCLK
  
  while(1)                                             //无限次while循环
  {
  }
  
}

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地板
wuhany| | 2018-8-9 17:46 | 只看该作者


楼主你的是P0 + P4 不是P1.0+P1.4

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5
jlyuan|  楼主 | 2018-8-9 17:48 | 只看该作者

应该用?

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6
shimx| | 2018-8-9 17:52 | 只看该作者
其实应该使用BIT0+BIT4

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7
zhaoxqi| | 2018-8-9 17:54 | 只看该作者
这编译时候不报错吗

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8
huangchui| | 2018-8-9 17:56 | 只看该作者

应该是
P1DIR   |=    BIT0+BIT4;
P1SEL   |=    BIT0+BIT4;

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9
huangchui| | 2018-8-10 12:27 | 只看该作者
这个程序的主要是设置打开了主辅时钟源的,然后让其输出的。

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10
jlyuan|  楼主 | 2018-8-10 12:29 | 只看该作者
好的,我知道啦

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