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关于Verlog TASK的问题

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楼主
jakfens|  楼主 | 2011-8-11 10:57 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式
verlog, verilog, 编写, 阻塞, 阻塞赋值
弱弱地问一下：在verilog里面，在编写task时，可以使用非阻塞赋值么？
听说task很难综合 那用ISE能综合出来么？

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沙发
AutoESL| | 2011-8-11 12:12 | 只看该作者
没试过,有空试试看

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板凳
jakfens|  楼主 | 2011-8-11 13:38 | 只看该作者
奶奶的 发现 fork.....join也不能综合
这么多东西不给综合 还让不让人活

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地板
lelee007| | 2011-8-11 16:37 | 只看该作者
:L

LZ找本教科书看看verilog的可综合设计吧;P

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5楼
SuperX-man| | 2011-8-12 08:47 | 只看该作者
LZ 可能写的不规范.我VHDL比较熟..Verilog才初学水平

不过,在ISE中有language template, 里面定义了所有相关的模板,LZ应该去看一下,按照规范写,应该就能综合了.

而且你可以把你综合报错的代码部分,或者报错信息贴上来,我们才可以讨论

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6楼
jakfens|  楼主 | 2011-8-12 08:52 | 只看该作者
好的 5# SuperX-man

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7楼
jakfens|  楼主 | 2011-8-12 08:52 | 只看该作者
哈哈 是啊 刚毕业的新手 4# lelee007

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