C6748系列DSP怎么实现高速数字序列输出

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 楼主| shimx 发表于 2018-9-6 15:11 | 显示全部楼层 |阅读模式
C6748系列DSP怎么实现高速数字序列输出
jiaxw 发表于 2018-9-6 15:14 | 显示全部楼层
太笼统了问的
 楼主| shimx 发表于 2018-9-6 15:19 | 显示全部楼层
TI 的C6748系列,要实现高速数字序列输出,例如编码了的信号输出,但输出位的位宽是10ns,也即是100MHZ的频率,我看了C6748的相关资料,发现没有哪个外设支持这么高速的接口
liliang9554 发表于 2018-9-6 15:23 | 显示全部楼层
BSP,PWM考虑了吗
 楼主| shimx 发表于 2018-9-6 15:27 | 显示全部楼层

都考虑过,都不行
lizye 发表于 2018-9-6 15:32 | 显示全部楼层
接收你编码输出的是什么器件
jlyuan 发表于 2018-9-6 15:38 | 显示全部楼层
也是可编程器件呢?
jiaxw 发表于 2018-9-6 15:42 | 显示全部楼层
可以考虑下加大位宽来降低速率。
jlyuan 发表于 2018-9-6 15:49 | 显示全部楼层
加大位宽?
jiaxw 发表于 2018-9-6 15:53 | 显示全部楼层
就是原来的8bit改为16bit
huangchui 发表于 2018-9-6 15:57 | 显示全部楼层
请楼主解释一下什么是“输出位的位宽是10ns”?
jiahy 发表于 2018-9-6 16:00 | 显示全部楼层
使用FPGA编程要好一些的。
lizye 发表于 2018-9-6 16:04 | 显示全部楼层
那绝对是纯数字的输出的。
 楼主| shimx 发表于 2018-9-6 16:06 | 显示全部楼层
哦,懂了,多谢大家
wyjie 发表于 2018-9-6 16:10 | 显示全部楼层
参考合众达的VPM642板子
zhanghqi 发表于 2018-9-6 16:14 | 显示全部楼层

需要有一个CPLD
jiaxw 发表于 2018-9-6 16:19 | 显示全部楼层
不用cpld行吗?
jlyuan 发表于 2018-9-6 16:22 | 显示全部楼层
应该怎么和flash连接,程序怎么编写?
yszong 发表于 2018-9-6 16:26 | 显示全部楼层
DM642的地址线只有EA3:EA22,20根。即1M的寻址空间。
yszong 发表于 2018-9-6 16:29 | 显示全部楼层
若使用S29GL256的24根地址线的flash,必要总线扩展。
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