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FPGA双向I/O口问题

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 楼主| 桂电蜗牛 发表于 2011-8-21 18:04 | 显示全部楼层 |阅读模式
FPGA, PGA, I/O
请教双向I/O口问题，谢谢
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XLDZZ 发表于 2011-8-21 21:52 | 显示全部楼层
看看单片机的双向口 不就解决了
hdl其实就是电路设计 写出来的也就是电路了
和c不一样的
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钻研的鱼 发表于 2011-8-22 09:28 | 显示全部楼层
表述不清楚，无法解答
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klffnj 发表于 2011-8-25 15:38 | 显示全部楼层
其实就是一个使能的问题，关掉一个入口不就只有出口了。
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yxs888 发表于 2011-8-25 21:33 | 显示全部楼层
FPGA 支持双向的 IO ，都有一个使能端，硬件上就是这样构成的。你描述的时候，assign out = en ? （1或者0） : 1'bz; en 为 0 时，IO 就处于高阻态，高阻态就是这个IO让对方来驱动。
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