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FPGA双向I/O口问题

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楼主
桂电蜗牛|  楼主 | 2011-8-21 18:04 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式
FPGA, PGA, I/O
请教双向I/O口问题，谢谢

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沙发
XLDZZ| | 2011-8-21 21:52 | 只看该作者
看看单片机的双向口 不就解决了
hdl其实就是电路设计 写出来的也就是电路了
和c不一样的

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板凳
钻研的鱼| | 2011-8-22 09:28 | 只看该作者
表述不清楚，无法解答

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地板
klffnj| | 2011-8-25 15:38 | 只看该作者
其实就是一个使能的问题，关掉一个入口不就只有出口了。

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5楼
yxs888| | 2011-8-25 21:33 | 只看该作者
FPGA 支持双向的 IO ，都有一个使能端，硬件上就是这样构成的。你描述的时候，assign out = en ? （1或者0） : 1'bz; en 为 0 时，IO 就处于高阻态，高阻态就是这个IO让对方来驱动。
[img][/img]

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