ADC采集频率高了看不到波形

发表于 2018-10-18 19:35

最近在做AD采集，ADC芯片是AD9613，最高250MSPS采样率，FPGA读取采样数据，通过chipscope观察采集数据，发现1M时可以很明显看到采集正弦波形，频率发到40MHZ以上，采集波形变得很杂乱，感觉是前级输入电路衰减太大，前级用的是300MHZ的运放做射极跟随器输入，然后单端输入到AD。本身AD是有差分输入接口的，差分负端接地了，现在不知道AD到底哪块出问题了，请教下大神些。F:\FPGA_study\123.png

登录 · 发表于 2018-10-18 19:38

忘记传电路了

发表于 2018-10-18 22:36

窗口没找好吧

发表于 2018-10-19 12:47

zhangmangui 发表于 2018-10-18 22:36
窗口没找好吧

什么窗口，没找到专门AD的区域啊

发表于 2018-10-19 17:18

问题解决了没？你可以换个ADC芯片试试

发表于 2018-10-19 21:33

采样太快了，fpga没有来得及处理？

发表于 2018-10-20 21:12

wrhwlj 发表于 2018-10-19 12:47
什么窗口，没找到专门AD的区域啊

AD DA都是存在找窗的找好了才能进行数据的采集

发表于 2018-10-21 14:27

FPGA0FLASH 发表于 2018-10-19 17:18
问题解决了没？你可以换个ADC芯片试试

目前在考虑，只是采样率较高，换的话周期较长，根本原因还是不清楚

发表于 2018-10-21 14:30

jianzhimail501 发表于 2018-10-19 21:33
采样太快了，fpga没有来得及处理？

我没拿来处理，只是通过内部逻辑分析仪采样显示，而且输入低频信号和高频信号都是同样采样率下啊，低频信号就能看到，难不成逻辑分析仪采样时钟太慢

发表于 2018-10-21 14:30

zhangmangui 发表于 2018-10-20 21:12
AD DA都是存在找窗的找好了才能进行数据的采集

找窗就是采样率么？没太懂

发表于 2018-10-21 21:10

wrhwlj 发表于 2018-10-21 14:30
找窗就是采样率么？没太懂

就是让时钟偏移去采集数据最稳定的地方
这个一般在高速接口中必须处理
网上找找资料

发表于 2018-10-22 07:56

zhangmangui 发表于 2018-10-21 21:10
就是让时钟偏移去采集数据最稳定的地方
这个一般在高速接口中必须处理
网上找找资料 ...

OK，谢谢

发表于 2018-11-2 22:55

ad前差分输入比较靠谱

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