通用的S2C V6 TAI Verification Module提供了三种使用模式：验证模式、调试模式和逻辑模式。 验证模式使用SCE-MI或定制的C-API通过一条 x4-lane PCIe Gen2通道实现海量数据和PC之间的传输。在调试模式中，V6 TAI Verification Module通过使用Xilinx ChipScope或者其它第三方工具从而实现了多个FPGA的同步调试且同时保持用户的RTL名。在逻辑模式中，用户可以原型化一个设计，其容量能达到 4.7M门。 所有对Verification Module的调试和验证设置都是在S2C 的TAI Player Pro™中完成。
验证模式
验证模式利用TAI Verification Module的高速PCIe Gen2接口将大量仿真数据在PC和TAI Logic Module之间进行双向快速地传输。该模式能将原型系统和仿真器直接连接进行同步仿真。用户可以利用下图所示的S2C提供的定制C-API或者符合行业 标准的SCE-MI接口:
调试模式
调试模式则利用了用户现有的Xilinx ChipScope或者其它第三方调试环境。V6 TAI Verification Module从Logic Module中的多个FPGA获取用户定义的信号并接收到V6 TAI Verification Module，通过JTAG接口与ChipScope连接。
V6 TAI Verification Module 使用Xilinx Chip Scope Analyzer可同时对放在两块Dual V6 TAI Logic Module上的FPGA设计进行调试。
最高能见度
每个Virtex 6 FPGA的120信号都接到了V6 TAI Verification Module的FPGA中。用户能在4 个V6 FPGA中进行120 x N信号的路径选择。最初的发布中，N固定在4上，但今后将由用户定义。用户所需要做的是在设计综合前在RTL级选择Probes并且将它们按照每个 FPGA120个probe来进行分组。S2C的TAI Player Pro自动采用多路复用技术将来自多个FPGA的调试信号发送至V6 TAI Verification Module的单个Xilinx ChipScope，并保留RTL名。将使用Xilinx ChipScope调试过程中的调试数据存储在V6 TAI Verification Module的存储器中直到满足预先设置的触发条件为止，再将这些调试数据读取出来。
逻辑模块
V6 TAI Verification Module可以作为单个原型板，为高达4.7M门容量的小规模SoC或ASIC设计使用。V6 TAI Verification Module可以配备Xilinx LX130T、LX365T 或者SX475T FPGA上，而且在4个LM连接器上共有480个外部I/O，x4 PCIe Gen2接口，4路通过SMA连接器的千兆串行收发器、一个SATA2接口以及一个USB3.0 PHY接口。
配置详情显示在下表:
可用性
V6 TAI Verification Module硬件现已供使用。 |
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