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FPGA设计的常用技巧整理

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AutoESL|  楼主 | 2011-10-9 22:20 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式
FPGA设计, AC, 串并转换
1. 串并转换

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沙发
AutoESL|  楼主 | 2011-10-9 22:21 | 只看该作者
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AutoESL|  楼主 | 2011-10-9 22:23 | 只看该作者
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地板
AutoESL|  楼主 | 2011-10-9 22:25 | 只看该作者
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对某些数据变换操作，如编解码，输入输出组合有限，当算法的实现非常复杂时，采用将输入输出关系表预存于RAM中的方式，利用查表直接得出结果

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5楼
AutoESL|  楼主 | 2011-10-9 22:28 | 只看该作者
5. PLL移相

利用FPGA内部的PLL/DLL，在源同步系统中将工作钟和输出钟进行移相（一般180度），可以使下游输入获得足够的输入建立时间，便于数据采样

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6楼
hjjnet| | 2011-10-9 22:41 | 只看该作者
顶，顶，顶

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7楼
hihu| | 2011-10-10 07:36 | 只看该作者
多谢斑竹

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8楼
hihu| | 2011-10-10 07:36 | 只看该作者
受教了

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9楼
jakfens| | 2011-10-10 09:07 | 只看该作者
不错哦 很形象

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10楼
AutoESL|  楼主 | 2011-10-10 19:26 | 只看该作者
直观，容易接受

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11楼
zy7598865| | 2011-11-7 22:11 | 只看该作者
这个可以

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12楼
mcu8031| | 2011-11-8 09:14 | 只看该作者
初来乍到,跟帖学习...

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13楼
wufeiwufei007| | 2011-11-8 09:35 | 只看该作者
初来乍到,跟帖学习...

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