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ISE 12中Xilinx FPGA的部分重配置

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kakio|  楼主 | 2011-10-11 07:19 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式
Xilinx正在改进其IP核与设计工具,以提高Spartan-6、Virtex-6和7系列FPGA的生产率。 PlanAhead™重新设计的全新用户界面不仅提供了RTL到比特流方法的简化流程,还可以实现更快的时序收敛和时序保存。AXI4 即插即用型 IP 套件可以改善设计的重用性并加速产品上市进程。

2100-3903-wp374partialreconfigxilinxfpgas.pdf

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