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[Actel FPGA]

异步清零

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楼主
3B1105|  楼主 | 2011-10-12 13:12 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式
异步, 触发, 信号, 74ls16, 电路
　同步是指与时钟同步，即时钟触发条件满足时检测清零信号是否有效，有效则在下一个时间周期的触发条件下，执行清零，异步是清零信号有效时，无视触发脉冲，立即清零。
　　例如74LS161采用异步清零，而74LS162,74LS163采用的是同步清零。在同步清零的计数器电路中，RD‘ 出现低电平后要等下一个CLK信号到达时才能将触发器清零。而在异步清零的计数器电路中，只要RD’ 出现低电平，触发器立即被置零，不受CLK的控制。

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lengshuihan0| | 2011-10-12 20:00 | 只看该作者
不错

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ty新气象| | 2011-10-18 10:44 | 只看该作者
嗯，简单明了。好学。

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shuaibaobao| | 2011-11-25 20:39 | 只看该作者
一看就懂，就喜欢这些东西。

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