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写进FIFO的却是n+1个数据

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楼主
ousj|  楼主 | 2019-5-28 22:47 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式
FIFO, FPGA, PGA, pi, gp

68013a,gpif,fifo写，fifo用FPGA来实现，
问题：我每次写n个数据的时候，wr_FIFO的长度却是n+1个clk长度，结果写进FIFO的却是n+1个数据？

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沙发
supernan| | 2019-5-28 22:48 | 只看该作者
GPIF波形有问题？你写的是8位的还是16位的？

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板凳
houcs| | 2019-5-28 22:49 | 只看该作者
用的是AUTO OUT？

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地板
yinxiangh| | 2019-5-28 22:50 | 只看该作者

1是波形
2是初始化
3是循环

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5楼
dingy| | 2019-5-28 22:51 | 只看该作者
对，比照一下CYPRESS的GPIF例子，用串口仿真一下。

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6楼
ousj|  楼主 | 2019-5-28 22:53 | 只看该作者

好的，我对比一下，谢谢大家

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7楼
zyf部长| | 2019-5-28 22:53 | 只看该作者
GPIF波形有问题？你写的是8位的还是16位的？

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8楼
morrisk| | 2019-5-28 22:54 | 只看该作者
用的是AUTO OUT？

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9楼
morrisk| | 2019-5-28 22:56 | 只看该作者

1是波形
2是初始化
3是循环

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10楼
xxmmi| | 2019-5-28 22:56 | 只看该作者

对，比照一下CYPRESS的GPIF例子，用串口仿真一下。

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11楼
ousj|  楼主 | 2019-5-28 22:58 | 只看该作者

好的，我对比一下，谢谢大家

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12楼
kkzz| | 2019-5-29 16:39 | 只看该作者
这个就是fifo的问题吧      

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13楼
hudi008| | 2019-5-29 16:39 | 只看该作者
可能你的计数有问题      

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14楼
lzmm| | 2019-5-29 16:40 | 只看该作者
把你的FPGA代码上传看看

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15楼
minzisc| | 2019-5-29 16:40 | 只看该作者
wr_FIFO的控制引脚呢   

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16楼
selongli| | 2019-5-29 16:40 | 只看该作者
代码的问题        

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17楼
fentianyou| | 2019-5-29 16:41 | 只看该作者
仿真测试看看是否有问题呢   

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18楼
xiaoyaodz| | 2019-5-29 16:41 | 只看该作者
必须使用FIFO写入吗？   

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19楼
xiaoyaodz| | 2019-5-29 16:41 | 只看该作者
可以使用SDRAM作为存储的        

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20楼
febgxu| | 2019-5-29 16:42 | 只看该作者
写n个数据，需要几个时钟周期？

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