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救命：FPGA输出周期信号，频率稍高，峰峰值就变小

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楼主
chinaitboy|  楼主 | 2011-11-2 19:13 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式
FPGA, 信号, PLL, AC, 时钟
用EP3C5E144内PLL生成48M时钟由43脚（PLL1_CLKOUTp）输出，驱动外围部件，发现信号很差，如图，请高手帮忙分析：

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沙发
chinaitboy|  楼主 | 2011-11-2 19:14 | 只看该作者
把频率调到6M，信号就正常了，中间的12M，24M信号介于两者之间。

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板凳
HWM| | 2011-11-2 19:23 | 只看该作者
负载容性过大（相对于此频率）。

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地板
chinaitboy|  楼主 | 2011-11-2 19:41 | 只看该作者
断开负载也是这个情况，感觉好像被虑波了。

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5楼
byeyear| | 2011-11-2 20:39 | 只看该作者
你用什么手段测量的 示波器？
确认示波器的带宽
表棒使用x10档

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6楼
chinaitboy|  楼主 | 2011-11-2 21:26 | 只看该作者
示波器，100M的，使用的是X1档，明天用X10试试，顺便问问，这两档区别是什么？

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7楼
HWM| | 2011-11-2 21:56 | 只看该作者
to 6L：

衰减度不同，X10比X1多衰减十倍。显然，用X1测量引入了较大的容性阻抗。

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8楼
圆圈| | 2011-11-2 22:09 | 只看该作者
1)增大驱动电流.  如可加上拉电阻增加驱动电流.
2)减小负载容抗

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9楼
李富贵| | 2011-11-2 23:35 | 只看该作者
示波器，100M的，使用的是X1档，明天用X10试试，顺便问问，这两档区别是什么？
chinaitboy 发表于 2011-11-2 21:26

X1档-3dB带宽一般在6~8MHz左右。
X10档-3dB带宽为标称值。

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10楼
nongfuxu| | 2011-11-3 07:47 | 只看该作者
查查EP3C5E144那个PIN输出模式.

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11楼
wangjun403| | 2011-11-3 10:04 | 只看该作者
应该是示波器测量的问题
FPGA  33M的输出看起来都快成正弦波了
500M的示波器

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12楼
fliger| | 2011-11-3 16:48 | 只看该作者
示波器的问题。

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13楼
lwq030736| | 2011-11-3 19:22 | 只看该作者
应该是示波器的问题

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14楼
nongfuxu| | 2011-11-4 04:01 | 只看该作者
那说明使用的示波器没有进行定期计量,校准了.
怪不得检测计量单位一出手都那么重,原来是多少时间没有给他们吃饭了.;P

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15楼
leoking0001| | 2011-11-4 08:48 | 只看该作者
3系统的， 不错啊！

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16楼
leoking0001| | 2011-11-4 08:49 | 只看该作者
哈哈，加油！！！！顶顶！

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17楼
大道至简| | 2011-11-4 08:57 | 只看该作者
频率高了，幅度变小是正常现象。不过四十几兆赫这样的幅度也太小了。如上大虾所述没可能是你的负载容性太强，或者示波器有问题。

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18楼
jimsboy| | 2011-11-6 14:02 | 只看该作者
示波器的使用问题
不能用X1去测这些信号。一般X1档只有6M的带宽

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