上升沿触发它的触发电压是如何定义的？

发表于 2019-8-18 18:13

上升沿触发它的触发电压是如何定义的？

发表于 2019-8-18 18:17

比如说TTL电平，是不是要5*90%=4.5V以上才算有一个触发呢？

发表于 2019-8-18 18:20

TTL我记得是2V左右吧

发表于 2019-8-18 18:23

问这个干嘛？datasheet 上没有吗？

发表于 2019-8-18 18:26

在TTL门电路中，把大于3.5伏的电压规定为逻辑高电平，用数字1表示；把电压小于0.3伏的电压规定为逻辑低电平，用数字0表示。

发表于 2019-8-18 18:31

在TTL门电路中上升沿是0—>1

发表于 2019-8-18 18:34

看datasheet上的Vih
5V的TTL的Vih至少要2V，CMOS要3.5V。

发表于 2019-8-18 18:37

不是达到这个值才会触发，而是达到这个值才是可靠的高电平，就单个器件来说，可能不到这个值就触发了。

发表于 2019-8-18 18:39

应该是从低电平到高电平的一个变化过程,高/低电平的定义一般datasheet 都有.

发表于 2019-8-18 19:17

这个,还需要一个时间,一般是几个CLK.

发表于 2019-8-18 19:19

不同的电平触发点不一样。TTL/CMOS/ECL等等

发表于 2019-8-18 19:22

芯片手册上有相关电气特性部分应该有说明的吧。

发表于 2019-8-18 19:26

结贴了，多谢大家讨论这么多哈，呵呵

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