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[FPGA] FIFO丢数据

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 楼主| 不妥协 发表于 2019-9-10 18:57 | 显示全部楼层 |阅读模式
FIFO, ip核, 赛灵思, ip
用赛灵思K7，FIFO IP核实现数据位宽的转换，64位宽数据转512位宽，FIFO写入480个64位宽数据应该读出来60个512位宽的数据，但是偶尔会丢1个512位宽的数据，只读出来了59个512位宽的数据。（我读的时候判断empty）
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zhangmangui 发表于 2019-9-11 22:21 | 显示全部楼层
这个肯定是没处理好    我们所有项目中都在使用  没有出现过的问题
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