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设计DSP的PCB板应注意哪些DSP问题

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楼主
zhaoxqi|  楼主 | 2019-9-13 13:55 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式
DSP, PCB, pcb板, pc
设计DSP的PCB板应注意哪些DSP问题

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沙发
dengdc| | 2019-9-13 14:01 | 只看该作者
电源的布置

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板凳
heweibig| | 2019-9-13 14:03 | 只看该作者


时钟的布置

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地板
wuhany| | 2019-9-13 14:06 | 只看该作者
还有电容的布置

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5楼
shimx| | 2019-9-13 14:10 | 只看该作者
P3.2是什么信号？

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6楼
jiaxw| | 2019-9-13 14:13 | 只看该作者


终端电路

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7楼
spark周| | 2019-9-13 14:15 | 只看该作者

看哪种了     具体的接口具体分享    原理图设计很重要
原理图中包括一些外设的分配和引脚的分配   实时要为画PCB的方便性考虑
画PCB时也要注意走线  保护   匹配等问题

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8楼
jiaxw| | 2019-9-13 14:30 | 只看该作者

时钟电路选择

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9楼
liliang9554| | 2019-9-13 14:32 | 只看该作者
尽量使用DSP片内的PLL,降低片外时钟频率,提高系统的稳定性

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10楼
jiaxw| | 2019-9-13 14:35 | 只看该作者
PCB的设计的方面的前面很多人都有分享的哈

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11楼
zhaoxqi|  楼主 | 2019-9-13 14:38 | 只看该作者
嗯，我再好好缕一缕吧，有了好消息及时通知大家，结贴喽

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12楼
usysm| | 2019-9-14 21:48 | 只看该作者
求高速DSP的PCB抗干扰设计技术?  

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13楼
typeof| | 2019-9-14 21:49 | 只看该作者
尽量使用DSP片内的PLL,降低片外时钟频率  

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14楼
yujielun| | 2019-9-14 21:49 | 只看该作者
未用的输出引脚可以悬空不接  

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15楼
htmlme| | 2019-9-14 21:49 | 只看该作者
DSP发展的片内存储器RAM越来越大  

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16楼
pklong| | 2019-9-14 21:50 | 只看该作者
信号在高速PCB板上沿传输线传输时可能会产生信号完整性问题  

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17楼
usysm| | 2019-9-14 21:51 | 只看该作者
电源, 地线的考虑不周到而引起的干扰,会使产品的性能下降  

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18楼
usysm| | 2019-9-14 21:51 | 只看该作者
在电源,地线之间加上去耦电容        

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19楼
uytyu| | 2019-9-14 21:51 | 只看该作者
最好是保留地层的完整性        

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20楼
iyoum| | 2019-9-14 21:52 | 只看该作者
传输线和接收端的阻抗 匹配

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