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xilinx的FIFO IP核求教？

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ottomia|  楼主 | 2011-11-24 17:16 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式
FIFO, ip核, XILINX, TI, TE
本帖最后由 ottomia 于 2011-11-24 17:17 编辑

今天在使用xilinx的FIFO IP核的时候，发现这个独立的时钟信号（wr_clk和rd_clk）不能任意修改频率值。如下：
file:///C:/Documents%20and%20Settings/ottomia/Application%20Data/Tencent/Users/544617299/QQ/WinTemp/RichOle/7(UN`8AOLJ4AS@AWC$~4B}A.jpg
上面显示的是1Mhz，如果我外部输入的是80Mhz,那对于这个IP核能否正常使用呢？谢谢！

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沙发
Backkom80| | 2011-11-24 19:53 | 只看该作者
可以的，

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zhaojingzb| | 2011-11-25 10:35 | 只看该作者
虽然看不到图片，但是之前用过，是可以用的

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