本帖最后由 GoldSunMonkey 于 2011-12-10 10:26 编辑
一个可逻辑综合的VHDL代码示例 (异步复位D触发器)
VHDL的设计流程
第一层次是行为描述。一般来说,在行为描述阶段,并不真正考虑其实际的操作和算法用何种方法来实
现,而是考虑系统的结构及其工作的过程是否能到达系统设计的要求。
第二层次是RTL方式描述。这一层次称为寄存器传输描述,系统采用RTL方式描述,才能导出系统的逻辑
表达式,才能进行逻辑综合。
第三层次才是逻辑综合。即利用逻辑综合工具,将RTL方式描述的程序转换成用基本逻辑元件表示的文
件(门级网络表)。 |
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