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[Actel FPGA]

接口时序问题

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楼主
feiyan2005|  楼主 | 2011-11-30 21:22 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式
接口时序, Libero, timer, TI
最近要写一个报告，要求给出最大，最小，典型工况下的接口时序，弱弱的问下，接口时序主要指哪些方便？是用工具分析出来的还是怎么弄的？需要什么工具？libero里面的timer能分析出来么？请高手指点

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沙发
rebewn| | 2011-12-2 12:59 | 只看该作者
帮你顶顶     我也想学习一下

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娃娃啊哇| | 2011-12-2 15:58 | 只看该作者
你是指什么接口时序？

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地板
xinchen| | 2011-12-2 16:53 | 只看该作者
楼主能说明白一点嘛

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