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chipscope使用问题

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674467523|  楼主 | 2011-12-6 22:47 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式
沙发
GoldSunMonkey| | 2011-12-6 23:45 | 只看该作者
应该不会的。
不行发工程上来~

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板凳
ertu| | 2011-12-7 06:45 | 只看该作者
最好在详细点

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地板
674467523|  楼主 | 2011-12-7 09:14 | 只看该作者
是这样的,我在模块中插入Chipscope IP核,是能够抓到FPGA内部的信号的,并且和modelsim仿真的时序一样,整个模块是挣够正常工作的,能在液晶屏上显示输出。但是我把这些IP核注释掉之后,重新生产bit文件,再下载到FPGA上,液晶屏上就没有显示输出。

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AutoESL| | 2011-12-7 10:10 | 只看该作者
有可能出现这种现象!
原因不明

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6
AutoESL| | 2011-12-7 10:11 | 只看该作者
你加入的Chipscope IP核会影响综合和PAR

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7
674467523|  楼主 | 2011-12-7 10:26 | 只看该作者
还有一个就是我用插入IP核的方法,是不是只能抓去例化此IP核的“.v”文件内的信号,不能够抓取子模块内的信号?
我想获取不同模块的内部信号,该怎么做呢?
谢谢!!!!

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受不了你| | 2011-12-11 21:16 | 只看该作者
可以的,如果找不到,你可以引到顶层几个信号与下输出 7# 674467523

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9
ooljo| | 2011-12-12 13:16 | 只看该作者
可以找到的呢

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ooljo| | 2011-12-12 13:16 | 只看该作者
:)

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11
GoldSunMonkey| | 2011-12-12 14:14 | 只看该作者
可以的,如果找不到,你可以引到顶层几个信号与下输出 7# 674467523
受不了你 发表于 2011-12-11 21:16

这个方式也可以。不过如果找不到,可以添加IP进去,即可。

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