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fpga 语句执行时间？fpga与cpu的关系？

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 楼主| dami270568577 发表于 2011-12-7 16:48 | 显示全部楼层 |阅读模式
CPU, FPGA, verilog, verilo, counter
在verilog语句执行一条语句的时间是多少啊？50mhz的晶振！还有就是有人告诉我verilog形成的是电路不是cpu 谈不上运行指令 ，但是向counter<=counter+1这样的语句还是要执行吧！这用verilog形成的电路与cpu的关系解释一下！谢谢！
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sxhhhjicbb 发表于 2011-12-7 18:52 | 显示全部楼层
效果是一样的。CPU指的是系统时钟可以跑多快，FPGA也由系统时钟跑多快确定。
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lwq030736 发表于 2011-12-7 21:40 | 显示全部楼层
这不是执行语句，是硬件的一种行为
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utopiaworld 发表于 2011-12-10 19:57 | 显示全部楼层
这个是电路不是程序，电路其实也是一部一部的，所有的电路都在同一个时钟沿进行动作，所以就不存在所谓的
先后顺序的问题，
CPU 和这个不一样，CPU需要一条一条的把指令从存贮器中取出来，执行
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liyafeng007 发表于 2011-12-19 15:44 | 显示全部楼层
顶4楼
最简单的一条赋值语句always @（ｐｏｓｅｄｇｅ　ｃｌｋ）　ａ＜＝ｂ；
如果ａ，ｂ是异步型号，你可以认为最短的执行时间就是一次触发器的翻转时间，只要满足建立保持时间，这条语句就会正确执行，约几百ｐｓ
如果ａ，ｂ是同步信号，都由ｃｌｋ产生，那么他的执行时间就是一个ｃｌｋ周期
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summerxue 发表于 2011-12-24 00:56 | 显示全部楼层
还是要学习一下电路方面的基础知识。
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