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请教:能否在VIRTEX4的板子上使用AXI总线

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miss_hit_529|  楼主 | 2011-12-8 10:59 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式
沙发
miss_hit_529|  楼主 | 2011-12-8 11:04 | 只看该作者
等待高手出现~由于本人的RTL代码是用axiapb总线实现的,如果直接挂在PLB总线上需要桥接,而EDK本身提供了这些桥接的IP核。以及AXI的IP核  但是只支持s6,v6以上的FPGA  有没有好的方法也让那些IP核也能在V4fpga上应用????

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板凳
Oxygen.Chu| | 2011-12-8 23:00 | 只看该作者
所有的总线都是RTL写出来的,楼主可以自己写一个AXI4的总线(桥)嘛~~

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地板
miss_hit_529|  楼主 | 2011-12-9 00:00 | 只看该作者
可是这样的话就太麻烦了,我想在V4的板子上直接调用EDK里面生成好的AXI4以及相关的桥  不知道有没有可能? 3# Oxygen.Chu

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opple| | 2011-12-9 13:09 | 只看该作者
这个我还真不是很清楚

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opple| | 2011-12-9 13:09 | 只看该作者
看看了解下

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miss_hit_529|  楼主 | 2011-12-11 18:08 | 只看该作者
依然还是谢谢你~ 5# opple

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