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[Actel FPGA]

designer多周期约束

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一个机会|  楼主 | 2011-12-25 15:10 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式
designer, ST, Train, AI, Constraint
我是在synplify中设置的多周期约束，没有设置路径(是从dvsor到n1的多周期约束)。在designer编译中出现如下错误
Error: in Constraint checker: Invalid multicycle constraint - the -to object list "\1I220/N_1[11]:D" is incorrect.
          From: \1I220/dvsor_1[1]:CLK
          Through: N/A
          To: \1I220/N_1[11]:D
       Constraint origin: D:/Actelprj/controller/synthesis/ally_sdc.sdc, line 509

问下这个是怎么回事？该怎么弄才能好呢？

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沙发
daisyly| | 2011-12-25 16:22 | 只看该作者
:$

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