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请教：DDR3内存的RESET初始化信号，是否是由ARM CPU软件控制DDR3内存控制器输出的？见内。谢谢。

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 楼主| 冰糖炖雪梨 发表于 2018-9-8 16:40 | 显示全部楼层 |阅读模式
ARM, CPU, 内存控制器, Reset, DDR3
请教：1、ARM SOC系统架构中， CPU的RESET信号与DDR3内存的RESET信号，是否没有硬件线路相连接？是两个独立分离的信号？  其中，  DDR3内存的RESET信号，是由ARM CPU软件控制DDR3内存控制器输出的？
2、ARM SOC系统的上电复位或运行中的复位（如：软件复位）过程中，其中的DDR3内存的复位，都是由ARM CPU软件控制DDR3内存控制器输出RESET信号给DDR3芯片，而实现DDR3的RESET初始化？
谢谢。
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