Spartan6 Core Generator DDR3

发表于 2012-1-10 12:49

在开发板上验证DDR3，用Coregen，生成DDR MIG，MAP的时候出现下面的错误：
ERROR:Place:1333 - Following IOB's that have input/output programming are locked
to the bank 1 that does not support such values
IO Standard: Name = LVDS_25, VREF = NR, VCCO = 2.50, TERM = NONE, DIR =
BIDIR, DRIVE_STR = NR
List of locked IOB's:
mcb4_dram_udqs_n
mcb4_dram_udqs
mcb4_dram_dqs_n
mcb4_dram_dqs
ERROR:Pack:1654 - The timing-driven placement phase encountered an error.

有几个问题请教下：
1、已经指定了DDR3在Bank4上，为什么“are locked to the bank 1”？
2、这都是按照MIG_Design的教程操作的，出现这样的错误，是不是说明软件有Bug？
3、我在网上查了，也有很多在设计DDR2的时候出现这样的问题，但没有具体的解答方法

发表于 2012-1-10 13:11

呃。。。问题好专业啊

发表于 2012-1-10 13:12

帮楼主顶起下吧估计猴版看到后会马上答复的

发表于 2012-1-10 17:24

你报错的信息是发现你的约束设置和实际的电路不相符合.
建议你还是根据提示出错的IO和实际的电路图对比一下,每个BANK电压是独立的,可能你设置的2.5V并不是那个BANK所支持的.

发表于 2012-1-10 17:26

把教程发我邮箱，我试一下。

发表于 2012-1-10 17:27

邮箱我一会短信发给你。

发表于 2012-1-10 17:27

你弄好后，给我发一个消息，告诉我。

发表于 2012-1-10 17:29

好的

发表于 2012-1-10 17:31

那是你的马甲？

发表于 2012-1-10 18:04

邮箱是？

发表于 2012-1-10 18:04

邮箱多少？ 9# GoldSunMonkey

发表于 2012-1-10 18:05

我还没有跟实际电路联系起来，只是根据参考手册将DDR3指定为bank4 4# GoldSunMonkey

发表于 2012-1-10 18:36

我已经给你发了两遍消息了。

发表于 2012-1-11 07:29

什么情况

发表于 2012-1-11 08:40

同学那是我的邮箱不是猴哥的不用发邮件给我猴子真该公布下邮箱这么多人找你

发表于 2012-1-11 09:36

不好意思啊，对论坛的短信息不不熟悉，刚才看到，已经发到你邮箱里了 13# GoldSunMonkey

发表于 2012-2-22 16:51

版主，我发给你的教程，是否收到了？

发表于 2012-2-22 23:32

我已经验证过了，完全没有问题。

发表于 2012-2-29 17:07

可不可以把你的工程发给我啊？我做了几遍都是这个问题，一直没有解决，谢谢了

发表于 2012-2-29 18:32

版主，可不可以把你的工程发给我啊？我做了几遍都是这个问题，一直没有解决，谢谢了

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