降低ADC的偏移误差

发表于 2021-3-2 22:58

STM32F407IGT6系统，需要测量8路交流模拟输入信号，采用规则转换方式，每周波（20毫秒）采样128个点，TIM4触发，DMA2读取；核心板子（86mm*68mm）为4层板，REF3033参考芯片，模拟与数字部分单点连接；在核心板上把模拟输入与VREF-短接，最大偏移误差有13 LSB（大多数情况下不超过5 LSB），调整ADC时钟、调整采样时间、增加电源（线性电源）滤波，没有看到效果，郁闷到极点。

发表于 2021-3-2 23:00

你的VREF-应该是跟GND接在一起的吧，那么大误差？

发表于 2021-3-2 23:04

刚才顺手找了两块F4的板测试了下，还是用手飞线连接，也没那么严重。

发表于 2021-3-2 23:06

除了考虑硬件线路因素外，测试时信号线不要太长，尽量焊接好。

发表于 2021-3-2 23:08

如果采样频率很低，确实很好，问题是我的系统必须确保每周波采样128点数据

发表于 2021-3-2 23:10

也就是TIM4每156.25uS(20000uS/128)启动一次转换，每启动一次，ADC自动采样4组（8个通道）数据。

发表于 2021-3-2 23:13

每周波采样128点，要考虑电容的之后效应了，肯定会有偏移的

发表于 2021-3-2 23:15

是不是外部电路设计不合理，先仿真测试看看

发表于 2021-3-2 23:17

嗯，那我按大家的说法挨个排查一下，谢谢哈

发表于 2021-4-1 10:16

硬件上是如何连接的啊

发表于 2021-4-1 10:19

请问什么叫做偏移误差啊

发表于 2021-4-1 10:20

对地短接试试看

发表于 2021-4-1 10:33

肯定会有偏移的

发表于 2021-4-1 10:34

需要多高的精度啊

[STM32F4] 降低ADC的偏移误差

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