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Xilinx FPGA中，管脚program_B请教

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wolfskin|  楼主 | 2021-3-5 10:33 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式
FPGA, program, XILINX, 管脚, xilinxFPGA
Xilinx FPGA中，管脚program_B为低电平时，FPGA程序会重新加载。请教，如果program_B一直为低(例如，有外部其他信号控制此管脚一直为低)，FPGA会一直反复加载程序吗？还是只加载一次？

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GavinZ| | 2021-3-6 09:38 | 只看该作者
手册里都有这些信息，自己看呗。

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板凳
tyw| | 2021-3-6 10:27 | 只看该作者
本帖最后由 tyw 于 2021-3-6 10:30 编辑

〓◆ Xilinx ise 9.x FPGA CPLD设计指南 387页 85.3M 清晰书签版 ◆〓
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