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[CPLD]

倍频 复杂PWM

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hezicheng2893|  楼主 | 2021-4-14 11:06 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式
各位大佬求救,毕业设计需要做到200M300M,老师说最好到500M,然后输出复杂PWM,然后我发现MAX I I或者V到不了这么高,然后老师说倍频,然后我去某宝看开发板,老板说因为没有锁相环CPLD没法倍频,另一个老板说最多到100M,可以自己单独配晶振,老师对CPLD根本也不懂,我现在好懵不,求指教,谢谢。

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hezicheng2893|  楼主 | 2021-4-14 11:08 | 只看该作者
老师现在让我最简单的输出两相PWM,移相角,占空比,频率可控,通过DSP给这些信息,CPLD编程实现PWM输出,整个设计就是做DSP的PWM模块细节上做不好的地方,然后让我做到这么高的频率,还要稳定,还要实现一些功能,让我自己考虑,比方说当DSP发出这三个信号变化或者占空比突然到0或者1的时候,CPLD输出的波形不能立刻变,要等到周期结束再变。大概是这个意思。

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zlf1208| | 2021-4-15 15:25 | 只看该作者
本帖最后由 zlf1208 于 2021-4-15 15:28 编辑
hezicheng2893 发表于 2021-4-14 11:08
老师现在让我最简单的输出两相PWM,移相角,占空比,频率可控,通过DSP给这些信息,CPLD编程实现PWM输出, ...

你查一下CPLD的器件手册,看看所选的芯片最高可以工作到哪个频率,手册上有说明的,根据我的**,应该达不到100MHz的,要倍频,首先要芯片能够在那个频率下工作。一般的CPLD内部是没有PLL的,以前用过Lattice的小FPGA倒是有PLL的,但是200MHz好像也到不了。

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