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我用FPGA整的,ARM能做单周期除法? drentsi 发表于 2012-3-11 16:05
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http://www.docin.com/p-200198263.html 号称2周期 zjp8683463 发表于 2012-3-11 22:28
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最快的就是用FPGA内部的硬件乘法器,但我还是不相信楼主用了9个周期
未命名.JPG (40.29 KB )
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触发器设计
2012-3-12 19:08 上传
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我只懂verilog,看不懂vhdl。不过我仍然保持我的怀疑: 1)作者的vhdl算法实现跟他**开头的文字描述,看上去不一致;文字描述了依赖于时钟的移位操作,既然是这样我认为不可能在两个cycle内就得到除法结果。 2) ... GavinZ 发表于 2012-3-12 14:06
多个移位操作是可以一个时钟内完成的。至少乘法器是可以单时钟内完成。 李冬发 发表于 2012-3-13 05:10
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