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verilog数据表示方法

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wolfskin|  楼主 | 2021-8-24 16:31 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式
verilog, 数据表, ST, Wire, TE, constant
本帖最后由 wolfskin 于 2021-8-24 16:33 编辑

想用verilog定义一个60位[59:0]的变量，该用何种形式定义？wire型。
直接用wire[59:0] temp = 455400859911164；    编译时提示：Decimal constant 455400859911164 is too large, using 1182548988 instead

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沙发
tyw| | 2021-8-24 16:51 | 只看该作者
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